带引脚分配的Quartus vhdl错误

时间:2014-03-04 01:21:43

标签: vhdl

我总是能够在不分配引脚分配的情况下编译我的项目。但是,现在我正在实例化项目目录中的某些文件,我收到了错误: 错误(35032):输出端口" pre_syn.bp.CPU_address_0 _"分区" Top"必须驾驶一个顶级别的引脚,但正在驾驶"" 我已经完成了我的研究,无法找到如何解决这个错误,因为我甚至没有在IOT获得完整编译之前首先分配引脚。 有谁知道这个错误意味着什么以及我如何追踪它? (quartus没有太多帮助)谢谢!

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