标签: vhdl
我正在尝试对 std_logic_vector 信号和 std_logic 信号使用逻辑运算符,并获取逻辑 1(高)或逻辑 0(低)的输出并将其放入 { {1}} 信号
std_logic_vector
std_logic
room1
但是,我遇到了错误。我是 vhdl 的新手,这是怎么做的?谢谢!